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Task #13
closed
Mise à jour de la documentation VHDL
Start date:
03/12/2013
Due date:
% Done:
0%
Estimated time:
revision:
Description
Vérifier la prise en compte des remarques de Vincent dans les documents FPGA (doc système et doc IP).
Updated by paul leroy about 10 years ago
- Status changed from New to Closed
Action à clore suite à point LFR 09 janvier 2014.
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