Activity
From 09/08/2014 to 07/09/2014
03/09/2014
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01:52 PM Task #227: Calibration
- Passage de l'issue en mode public.
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09:42 AM Feature #33 (Closed): sous-échantillonnage des signaux électriques DC (s1, s2 et s3)
- Suppression, Feature intégrée à la Task #228.
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09:42 AM Feature #31 (Closed): filtrage + sous échantillonnage 8 voies
- Suppression, Feature intégrée à la Task #228.
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09:40 AM Task #228: DECIMATION
- Update après la suppression de la Feature #33:
La recommandation précédente ne doit pas s'appliquer sur des signau... -
09:39 AM Task #228: DECIMATION
- Update après suppression de la Feature #31:
Pour l'implémentation du filtre sous-échantillonneur en VHDL, les reco...
02/09/2014
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12:00 PM Task #230: Rédaction de la demande de modification pour STEEL
- Ci joint le draft V1 de la demande de modification, à compléter avec tous les documents cités mis à jour.
29/08/2014
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08:36 AM Task #18: PPBI et programmation des FPGA
- Mail envoyé à Jérône Carron suite à la lecture es documents qu'il a fournit sur l'exemple de TARANIS. Le LPP n'a pas ...
28/08/2014
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08:56 AM Task #228: DECIMATION
- Le design suivant a été proposé pendant un point LFR:
* 24 576 => 4096 => même filtre que le filtre anti-repliement ...
27/08/2014
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02:53 PM Task #230 (Closed): Rédaction de la demande de modification pour STEEL
- Compléter la liste pour la demande de modification à adresser à STEEL:
=> ajout des capas sur les entrées BIAS_4 et ... -
10:58 AM Task #228 (In Progress): DECIMATION
- Se renseigner sur les filtres de decimation
Commencer a definir ces modules -
10:55 AM Task #227 (Closed): Calibration
- Se renseigner sur le module de calibration
Commencer a definir ce module -
10:27 AM Task #17 (Closed): Finalisation des développements du module Spectral Matrices
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