Activity
From 11/03/2015 to 09/04/2015
09/04/2015
- 03:28 PM Bug #381 (Closed): Timing HK erroné sur certains tests de charge
Nous avons lancé des test de charge de 10 à 15h en fonction du mode.
Pour cela nous avons activé les logs car le c...
07/04/2015
- 04:25 PM Bug #317 (Closed): données cross-corrélation ASM erronées ?
- Les derniers tests effectués à ce jour permettent de déterminer la phase d'un signal sinusoïdal injecté à 0.1° près, ...
- 03:53 PM Bug #317 (Resolved): données cross-corrélation ASM erronées ?
- Retester dans VHDL >= x.1.68 et FSW >= 2.0.2.3
- 03:51 PM Feature #236 (Closed): niveau bruit ASM oscillant ! (sauf sur b1b1 ?)
- Résolu dans VHDL >= x.1.68
20/03/2015
- 12:42 PM Bug #250 (In Progress): temps des ASM pas bien défini
- Des tests ont été fait avec pas mal de fichiers durant les procédures automatiques de calibration/étalonnage
Avec la... - 11:40 AM Feature #344 (Closed): LFRControlPlugin : format du nom des fichier de sortie "Record Raw data" avec heures, minutes et secondes sur 2 digits
- Testé OK
- 11:09 AM Feature #344 (Resolved): LFRControlPlugin : format du nom des fichier de sortie "Record Raw data" avec heures, minutes et secondes sur 2 digits
- Depuis LFRControlPlugin 1.0.0.1 avec la livraison de la version 1.1.68 du VHDL cela marche du tonnerre! :)
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