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Feature #159

closed

temps des snapshot décalés de +256 * 2^-16 s

Added by thomas chust over 10 years ago. Updated over 10 years ago.

Status:
Closed
Priority:
Normal
Assignee:
paul leroy
Category:
-
Target version:
-
Start date:
22/05/2014
Due date:
% Done:

0%

Estimated time:

Description

Tout est dans le titre. Plus d'explication dans le fichier joint.

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time tests_data 2014_4_17-10_19_2.odt (28.3 KB) time tests_data 2014_4_17-10_19_2.odt thomas chust, 22/05/2014 11:47 AM
tests_bruits_miniLFR5_2014_06_23.odt (39.1 KB) tests_bruits_miniLFR5_2014_06_23.odt thomas chust, 24/06/2014 11:52 AM
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 #1

Updated by paul leroy over 10 years ago

  • Status changed from New to Resolved
  • Assignee changed from paul leroy to thomas chust

fsw >= 1.0.0.9

bug identifié et corrigé

La période des snapshots est déterminée par le paramètre delta_snapshot du VHDL. L'unité de ce paramètre est 1/256 s. Il y avait un décalage de 1/256 s dans la prise en compte de la période des snapshots.

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 #2

Updated by thomas chust over 10 years ago

  • Status changed from Resolved to In Progress

Paul, les tests on été refait avec mini LFR5 sous la version 1.0.0.9b du FSW (et VHDL 0.1.16). Rien n'a changé, mêmes observations. Donc pb pas encore résolu ...
Concernant le centrage des snapshots il y a par contre eu un petit changement par rapport à la dernière fois. Ce changement concerne le paramètre Delta_f2_f1. Effet collatéral?
Thomas

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 #3

Updated by thomas chust over 10 years ago

  • Assignee changed from thomas chust to paul leroy

Paul, les tests on été refait avec mini LFR5 sous la version 1.0.0.9b du FSW (et VHDL 0.1.16). Rien n'a changé, mêmes observations. Donc pb pas encore résolu ...
Concernant le centrage des snapshots il y a par contre eu un petit changement par rapport à la dernière fois. Ce changement concerne le paramètre Delta_f2_f1. Effet collatéral?
Thomas

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 #4

Updated by paul leroy over 10 years ago

  • Status changed from In Progress to Resolved

fsw >= 1.0.0.12

Je pense que ce problème est une conséquence de la fausse manip que j'ai faite il y a quelques semaines, la modif avait été écrasée.

C'est remis en état, ça devrait fonctionner.

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 #5

Updated by paul leroy over 10 years ago

  • Assignee changed from paul leroy to thomas chust
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 #6

Updated by thomas chust over 10 years ago

Des tests on été effectués avec la configuration suivante : VHDL 0.1.23 & FSW 1.0.0.12
Cela fonctionne maintenant comme il faut. Plus d'infos dans le fichier joint.
Bravo ! :)

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