Le soft a été installé et les fichiers suivants adaptés
- /opt/VALIDATION_R3/lfrverif/param.py (lfr_ver_str = "3.0.0.9") utilisé par verif_field.py
- /opt/VALIDATION_R3/LFRControlPlugin_start.py (FSW_VER = "3.0.0.9")
- /opt/VALIDATION_R3/LFRControlPlugin_startAll.py (FSW_VER = "3.0.0.9")
l'espace de validation a été crée /home/validation/data/R3/3.0.0.9
le script /home/validation/SCRIPT/just_hk_survey.py a été joué et la version de soft est correcte (verif_field.py a été executé sans ereur).
SY_LFR_SW_VERSION_N1=*3*, SY_LFR_SW_VERSION_N2=*0*, SY_LFR_SW_VERSION_N3=*0*, SY_LFR_SW_VERSION_N4=*9*, SY_LFR_FPGA_VERSION_N1=1, SY_LFR_FPGA_VERSION_N2=1, SY_LFR_FPGA_VERSION_N3=89
le fichier 2015_10_01-08_11_43-Detail.txt est dans /home/validation/data/R3/3.0.0.9/TEST-UNITAIRES/JUST-HK.
Le contexte du test
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FSW : 3.0.0.9
VHDL 1.1.89
EM2 sans timegen
SocExplorerEngine.getSocExplorer: Version = 0.6.2, Branch = default, Changeset = 819d0376d481
StarDundee
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